Circuit numérique de mesure de phase

Digital phase measuring circuit

Digitale Phasenmesschaltung

Abstract

Zum Ermitteln der Phasendifferenz zwischen der Flanke eines Impulses eines ersten Taktsignals und der Flanke eines Impulses eines zweiten Taktsignals wird das zweite Taktsignal (Ck2) bei der integrierbaren Phasenmeßschaltung über einen Frequenzteiler-Schaltkreis (FF) an den Eingang einer nichtgetakteten Verzögerungsleitung (V) mit m Verzögerungs­gliedern (Vc1...Vcm) und als Taktsignal an ein zweites Register (R2) mit m Registerzellen (R21... R2m) angelegt, während die ebenfalls m Registerzellen (R11...R1m) eines ersten Registers (R1) vom ersten Taktsignal (Ck1) getaktet werden. Die Ausgangssignale der k-ten Registerzellen werden jeweils im k-ten XOR-Gatter einer Reihe von m XOR-Gattern (G1...Gm) verglichen, so daß bei unterschiedlichen Pegeln jeweils eine logische Eins an dem Ausgang des betrachteten k-ten Gatters (Gk) liegt. Die Phase ergibt sich durch Addieren der logischen Pegel am n-stelligen Ausgang (A) eines Vielfachaddierers (Ma) in einer Genauigkeit entsprechend m, wobei vorteilhafterweise m = 2 n beträgt.

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Patent Citations (3)

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